FPGA - 平头弟

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Quartus里ALTLVDS模块和GXB的区别在哪里

robertslyh 2019-03-25 08:18

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收发器在接收端为什么要采用一个bitslip模块以及该模块的实现

robertslyh 2019-03-25 08:18

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FPGA 中能放几个51 内核怎么级联

jjjiao123 2019-03-25 08:18

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求助：谁知道什么器件可以把数字信号转换为网络信号

chilezhima 2019-03-25 08:18

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FPGA控制DA的问题

astwyg 2019-03-25 08:17

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最近在做fpga最小系统，遇到问题求教

ghdnui 2019-03-25 08:17

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CPLD JTAG口可以作为I/O口吗？该如何设置？MAX_PLUS2!

duansongtao123 2019-03-25 08:17

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ghc8818 2019-03-25 08:17

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zhenpeng25 2019-03-25 08:17

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nios 11.0版本编译问题

tianma123 2019-03-25 08:17

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请教下modelsim中怎么仿真PLL

astwyg 2019-03-25 08:17

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天方破晓 2019-03-25 08:17

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astwyg 2019-03-25 08:17

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用fpga实现以太网通信，如何进行测试

wjk2009 2019-03-25 08:16

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QUARTUS 仿真产生的tbl文件怎么输入到matlab中画图？

zhenpeng25 2019-03-25 08:16

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