FPGA - 平头弟

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CPLD一个很奇怪的问题

mlovew723 2019-03-25 08:15

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FPGA做AD采样，这种情况如何编程？

喜鹊王子 2019-03-25 08:15

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有关xilinx中fft ip核的scale_sch的设置问题

eeleader 2019-03-25 08:14

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verilog 状态机

zxb3558493 2019-03-25 08:14

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quartus里差分输入怎么分配引脚呢？

zhenpeng25 2019-03-25 08:14

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跪求高手指点CYCLONE 片内RAM读写问题

mc516 2019-03-25 08:14

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CF卡读写VHDL源代码

eeleader 2019-03-25 08:14

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有没有人用过cycloneⅣ的lvds宏的啊

织染 2019-03-25 08:14

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基于FPGA的步行街道自助式交通灯控制器设计

zeyuanhu 2019-03-25 08:14

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第一次见到FPGA实物的小菜鸟有问题求助

墩墩 2019-03-25 08:14

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求助，cpld烧写后校验错误

gb39072521 2019-03-25 08:14

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Altera FIFO核数据写不进去

KwingsLee 2019-03-25 08:14

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以太网数据帧中的目的地址

wanglei0307 2019-03-25 08:13

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SDRAM刷新操作

火箭_1991 2019-03-25 08:13

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ise上做的分频程序创建约束时出现your design has no clocks ！！！

yushiga 2019-03-25 08:13

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