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Xilinx 3500项专利、60项行业第一喜迎30周年
jameswangchip
2020-02-24 20:19
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请问中国各大通讯公司和汽车公司使用FPGA的语言?
h202234
2020-02-24 20:19
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.【有奖活动】庆祝赛灵思中文社区论坛正式开通,抢楼送祝福
mzhang198
2020-02-24 20:19
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[求助]时序报告满足,但后仿真数据无法在一个周期内稳定
yunxiaoxiao110
2020-02-24 20:19
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【求助】planahead出现时序问题,请问该如何解决呢
502593045
2020-02-24 20:19
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求助,quartus II 编译之critical warning
braverty
2020-02-24 20:19
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关于 EDA RTL simulation 的问题
曹克强
2020-02-24 20:19
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跨时钟的信号一定要做同步处理,请问同步处理是下面哪种
entepino
2020-02-24 20:19
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verilog 今日心得
TataJen
2020-02-24 20:19
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友晶科技DE2-115母板和DVI子板,台湾人卖水货
zy9914202
2020-02-24 20:18
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一种基于CPLD的DSP人机接口模块设计 (1)
星星之火红
2020-02-24 20:18
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关于Quartus II 13.0输入括号()的问题
luyaker
2020-02-24 20:18
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ML605 MIG 等不到 app_rd_data_valid有效
harborn
2020-02-24 20:18
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对学习 I2C 总线的求助
sunt8707
2020-02-24 20:18
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移植到VIVADO 的错误,错误如下
yzh0912
2020-02-24 20:18
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