FPGA - 平头弟

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用verilog hdl编写的19位计数器的testbench如何编写？

爱吃饼子的喵 2019-03-25 07:16

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这张原理图LDE灯连到FPGA的哪个管脚上

chenbingjy 2019-03-25 07:15

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FPGA的问题

chenbingjy 2019-03-25 07:15

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分频器仿真结果不对

chenbingjy 2019-03-25 07:15

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FPGA工程师都干什么

chenbingjy 2019-03-25 07:15

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编译警告的问题

chenbingjy 2019-03-25 07:15

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2011年电子设计大赛E题（简易数字信号传输性能分析仪的设计）求大神指导

刘朝阳@ 2019-03-25 07:15

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verilog是不是没有浮点型数据

chenbingjy 2019-03-25 07:15

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RTL图

CoffeeOrTea 2019-03-25 07:15

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vivado中AXI转I2Cip核的使用时读不到数据

swaggy 2019-03-25 07:15

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CPLD驱动串行LCD12232的问题

chenbingjy 2019-03-25 07:15

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求助，基于FPGA的电子密码锁，无法正常运行

半世逍遥 2019-03-25 07:15

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嘀哩嘀哩 2019-03-25 07:15

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如何获得SDAccel2017.4的license？

梨子李子栗子 2019-03-25 07:15

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fpga里面的system ID有什么用途

2638823746 2019-03-25 07:15

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