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• TY20141117 2019-07-15 22:34

NIOSii 软件中收到的数据传递到FPGA 底层模块如（top）

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• 以太网模块

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• 杜健健 2019-07-15 22:34

学习FPGA用哪款板子比较好？

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• lllong 2019-07-15 22:34

用system generator设计的时候总会出现 “Error occurred during "Simulation Initialization" ”

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• xyd520 2019-07-15 22:34

FPGA的基本结构

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• 剑圣sama 2019-07-15 22:34

用VHDL作了一个3相正弦波电路，波形老是有4个数值全为0的点，弄了半天了，求大神看看

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• 281110040 2019-07-15 22:33

xilinx ISE中文注释

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• fdfghj 2019-07-15 22:33

关于max6675的使用问题

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• 薛家少爷_SVIP 2019-07-15 22:33

大神帮忙看看，为什么我的开发板无法用电脑进行配置

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• mc1930 2019-07-15 22:33

请问有基于Xtensa内核的FPGA测试板或者开发板吗？

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• 蓝色软糖 2019-07-15 22:33

xilinx，ddrmig文件中管脚分配

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• cramile 2019-07-15 22:33

verilog代码错，请大家帮忙看一看

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• 拾荒皇子 2019-07-15 22:33

Alter FPGA用JTAG方式下载jic文件固化失败?

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• whainia186 2019-07-15 22:33

有木有，深圳的FPGA设计工程师 看新机会的呀？

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• 艾米莉亚 2019-07-15 22:32

怎样用Verilog编一个蜂鸣器的驱动电路啊！可以告诉我为什么吗？

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• 无尽的爱 2019-07-15 22:32

DDR读写问题

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