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我想用vivado的debug用法看看自己写的程序对不对，但是当我用vhdl写进程时，敏感信号没有时钟就会报错，如下图
报的错误
自己写的代码是这样的
![2SP$]K_I{N32Y240VLDVT3Y.png](data/attach/1903/ngh6vapdt5bze5tx9urdke08e2pt2i2z.png "2SP$]K_I{N32Y240VLDVT3Y.png")
但是我要把代码改成下图的就不会出现这个问题
难道只因为有了时钟吗？没有时钟就不可以吗？
而且下面这个逻辑不是我想要的，不知道怎么办？
可能我说的也不是很清楚，有好心的大牛想帮我这个小白的话，可以加我qq 153041342
或者可以评论给我指导一下，万分感谢。
此帖出自小平头技术问答
自己写的代码是这样的
但是我要把代码改成下图的就不会出现这个问题
难道只因为有了时钟吗？没有时钟就不可以吗？
而且下面这个逻辑不是我想要的，不知道怎么办？
可能我说的也不是很清楚，有好心的大牛想帮我这个小白的话，可以加我qq 153041342
或者可以评论给我指导一下，万分感谢。
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一顿改之后又出现这个问题，好烦。
去官网看，也没给一个满意的解决方案。
那应该怎么改呢？
虽然我已经改完了，但是我还是想知道既然组合逻辑不能相加，那我应该用什么来代替呢？
但是要用时序逻辑的话，就不能写出我想要的结果。
或许能写出来，但是我没有想到
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