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DSP与FPGA通信

2019-08-01 16:53发布

站内问答 / TI MCU
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要实现TMS320F28335与FPGA内置RAM的通信，要用到DSP中外部扩展接口功能，我想问的是，外部扩展接口中LEAD,ACTIVE,TRIAL,该如何配置？
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5条回答
airwill
1楼-- · 2019-08-01 22:44
在手册的外部接口里详细讲述了.
分成无等待, 同步模式, 异步模式. 有详细的表格来描述这些设置以及时序图, 最好去仔细啃啃吧
zhangmangui
2楼-- · 2019-08-02 02:35
我做过DSP5509A和FPGA的通信  用的是EMIF接口
只需要接CS，XWE,XRD就可以啦  不知你是怎么接的  
参考一下代码   多多找些XINTF相关的资料

Xintf初始化：
  // All Zones:
    // Timing for all zones based on XTIMCLK = SYSCLKOUT/2
    XintfRegs.XINTCNF2.bit.XTIMCLK = 1;  // XTIMCLK = SYSCLKOUT/2
    XintfRegs.XINTCNF2.bit.CLKOFF = 1;   // DISABLE XCLKOUT
        XintfRegs.XINTCNF2.bit.WRBUFF = 0;   // NO WRITE BUFFER
        XintfRegs.XINTCNF2.bit.CLKMODE = 1;  // XCLKOUT = XTIMCLK/2
        // Zone 0
        // Ignore XREADY for Zone 1 accesses
        // Change read access lead/active/trail timing
        XintfRegs.XTIMING0.bit.USEREADY = 0;
        XintfRegs.XTIMING0.bit.XSIZE = 3;                // ALWAYS WRITE TO 11BIT
        XintfRegs.XTIMING0.bit.XWRACTIVE = 3;
        XintfRegs.XTIMING0.bit.XWRTRAIL=7;
        XintfRegs.XTIMING0.bit.XWRLEAD=3;
        XintfRegs.XTIMING0.bit.XRDLEAD = 3;
        XintfRegs.XTIMING0.bit.XRDACTIVE =7;
        XintfRegs.XTIMING0.bit.XRDTRAIL = 3;
        // Double lead/active/trial timing for Zone 1
        XintfRegs.XTIMING0.bit.X2TIMING=1;
zhangmangui
3楼-- · 2019-08-02 03:14
 精彩回答 2  元偷偷看……
1988020566
4楼-- · 2019-08-02 03:14
如果是访问，就是外设来设置就行
1988020566
5楼-- · 2019-08-02 07:00
是读还是写  都是由你自己规定的

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