CPLD用model仿真，编写testbench 出现错误，该如何解决，请版主大神解答指点迷津。

2019-03-25 07:20发布

站内问答 / FPGA
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自己编写CPLD程序，想用modelsim进行仿真，于是在Quartus里面编写testbench文件，但是出现上图错误，请高手解答一下。不胜感激！！！！！
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2条回答
596937862
1楼-- · 2019-03-25 13:52
< / .............
zimiaoxinghan
2楼-- · 2019-03-25 15:18

用Quartus编译VHDL程序，完全没错误。在此前提下，想要进行仿真来看看信号波形，需要编写Testbench，想利用Quartus软件的模板，结果出现上述的错误---说是不支持该芯片。为什么配置和编译程序文件时，没有出现支持错误？？该如何解决，希望高手指点一下………………

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