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定义枚举类型时,内容不能用not,xor等已有保留字吗?
2019-03-25 07:52
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FPGA
8990
1
965
本帖最后由 pinggougou 于 2015-2-27 00:29 编辑
我定义一个数组,type state is (inc,dec,add,not,load);
语法检查提示:ERROR: syntax error near not (VHDL-1261)
把not去掉后,就正确了!!这是为什么呢?? 此帖出自
小平头技术问答
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1条回答
lelee007
1楼-- · 2019-03-25 15:07
< / 不懂VHDL,不过绝大多数语言都是不支持使用关键字和保留字做变量名使用的
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