2019-03-25 09:52发布
个人认为：
1. CPLD完成与PCI9054本地总线的通信控制，接收正确下载数据。
2. 上位机与CPLD数据传递过程中要保持数据的正确性，而且要一次传递完成。
3. 接收完成正确的数据后，然后CPLD通过FPGA的SPI接口配置数据到FPGA。
原帖由 eeleader 于 2011-11-21 08:32 发表 个人认为： 1. CPLD完成与PCI9054本地总线的通信控制，接收正确下载数据。 2. 上位机与CPLD数据传递过程中要保持数据的正确性，而且要一次传递完成。 ...
流程确实是这样。上位机通过软件将程序发到PCI接口芯片9054，然后9054将数据发给CPLD，CPLD就要配好FPGA的配置时序（例如PS模式）。这其中CPLD还要反馈配置过程中的状态，是否出错之类的。
问题是编程文件中的数据该如何提取，比如rbf文件，hexout文件等其中的数据提取成了我主要的问题。多谢各位的解答
原帖由 jjkwz 于 2011-11-20 16:20 发表 您说的这个，我从来就没听说过，哎，见识短浅了，不过我会关注你的，帮你顶起来，然后呢，跟你一起学习，一起进步！
恩呢，这个论坛里还没有这方面的资料，等我做好了就把资料共享一下
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个人认为：
1. CPLD完成与PCI9054本地总线的通信控制，接收正确下载数据。
2. 上位机与CPLD数据传递过程中要保持数据的正确性，而且要一次传递完成。
3. 接收完成正确的数据后，然后CPLD通过FPGA的SPI接口配置数据到FPGA。
流程确实是这样。上位机通过软件将程序发到PCI接口芯片9054，然后9054将数据发给CPLD，CPLD就要配好FPGA的配置时序（例如PS模式）。这其中CPLD还要反馈配置过程中的状态，是否出错之类的。
问题是编程文件中的数据该如何提取，比如rbf文件，hexout文件等其中的数据提取成了我主要的问题。多谢各位的解答
恩呢，这个论坛里还没有这方面的资料，等我做好了就把资料共享一下
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