基于CPLD的开关稳压电源设计 求帮助

2019-03-25 10:04发布

站内问答 / FPGA
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各位朋友，我的课题是基于CPLD的开关稳压电源设计，在QuartusⅡ软件界面中利用Verilog HDL语言完成从设计输入到硬件配置的完整CPLD设计流程。实现输出电压1.25~15V，分辨率为0.01V；纹波不大于3dB；输出功率不小于15W的总体要求。
   我想问下软件设计时该选择什么芯片 此帖出自小平头技术问答
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1条回答
eeleader
1楼-- · 2019-03-25 13:25
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如果要时序如开关电源芯片控制器UC3844的功能，估计CPLD还完成不了，因为容量太小了。那样建议选用FPGA。如果只是做负反馈控制+电压采样控制，选择一个MAX 1270。ALTERA的第II代CPLD。

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