2020-01-01 17:49发布
NJ8888 发表于 2016-6-29 22:31 FPGA时序逻辑更烦,只要不是标准外设接口,一大堆相互前后牵涉的标志控制状态机,越写越难懂(开始简单, ...
myxiaonia 发表于 2016-6-30 09:08 明明只有一个人,你还说一个模块就有2个人
lnskngdc 发表于 2016-6-29 16:38 这个还真不是这样的,高水平的工程师应该是用最简洁的语言实现相对高效的功能,可读性要第一,效率第二。 ...
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是的....
我说的就是这样子的,但是会有一个文档配合描述。。。只是在程序里不写。。。然后删除文档。。。
哈哈,不是要解决这个问题么,接下来多招几个
可读性要第一,效率第二。
我是不是听错了。
一个函数封装一个功能。根本不用看懂
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