引脚输出不是期望的

2019-03-25 10:17发布

站内问答 / FPGA
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程序中用 assign rd_n=1;进行付值,但在器件管脚出用示波器测量为0, 望得到高手指点. 此帖出自小平头技术问答
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2条回答
110500623
1楼-- · 2019-03-25 14:19
< / 能否说细点，比如代码是否有问题，如果就这么一句话肯定有问题的啊
wanglei0307
2楼-- · 2019-03-25 16:38
谢谢啊,可能是没测好,已经解决了

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