我的“关于5V容忍电压的实验”：
0. 实验芯片：STM32F101C6T6A。
1. 置PB6于OG输出模式。
2. 5V容忍脚（选PB6）串接12K电阻到“外接电压”。
3. “外接电压”=8.00V，VPB6在输出1，0时，分别为7.92V和0.02V。
4. “外接电压”=5.50V，VPB6在输出1，0时，分别为5.50V和0.02V。
5. 5V容忍脚（选PB6）串接200欧姆电阻到“外接电压”。
6. “外接电压”=5.50V，VPB6在输出1，0时，分别为5.50V和0.66V。
结论：ST资料中关于“VDD_FT”的描述是不严肃的。
关于这个问题的讨论已经1年半了。
刚发的帖子“__STM32__，关于开漏输出，是否已有结论？ ”又得不到回应。很不高兴。
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ST:你管我VDD_FT是多少，我就只告诉你在5v下能用，要是在5V下坏了算我的，高出5V使用造成不可挽回的后果自己负责！
我看最大的可能是不能箝位只能容忍，为啥这么说呢，任何降压电路，包括线性稳压或者buck电路，不带负载的话，都不能箝位到输出电压vout，假如stm32内部有升压电路产生vdd_ft，但是此电路没有负载，到哪里去把灌电流泄放，毕竟输出端并不能输入电流啊
所有的箝位最终都是靠负载来箝位的
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