VHDL中如何将两个模块中的inout互联？

2019-03-25 10:34发布

站内问答 / FPGA
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紧急求助： VHDL中如何将两个模块中的inout互联？？？？ 正在做一个接收I2C模块，为了验证，想写一个发送模块进行验证， 但是如何将两个inout互联，搞了半天也搞不明白， 十分着急，做过的兄弟快点来看看啊！ 此帖出自小平头技术问答
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2条回答
tx_xy
1楼-- · 2019-03-25 15:52
< / 两个 inout互联 直接连啊 没问题滴 只是IO方向指示信号要搞好。
wenhuawu
2楼-- · 2019-03-25 17:35
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