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kintex7上调试ddr2时example design工程的init calib complete都没拉高
2020-01-26 17:42
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FPGA
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除了UCF以外，没有加我自己的东西，完全是mig生成的工程
仿真没有问题但是debug时init calib complete没有拉高
有没有人遇到过类似问题？
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{var%20f='http://v.t.sina.com.cn/share/share.php?appkey=1515056452',u=z||d.location,p=['&url=',e(u),'&title=',e(t||d.title),'&source=',e(r),'&sourceUrl=',e(l),'&content=',c||'gb2312','&pic=',e(p||'')].join('');function%20a(){if(!window.open([f,p].join(''),'mb',['toolbar=0,status=0,resizable=1,width=440,height=430,left=',(s.width-440)/2,',top=',(s.height-430)/2].join('')))u.href=[f,p].join('');};if(/Firefox/.test(navigator.userAgent))setTimeout(a,0);else%20a();})(screen,document,encodeURIComponent,'','','https://www.xiaopingtou.cn/data/attach/logo/logo.png', '推荐 gnr_zhao 的问题《kintex7上调试ddr2时example design工程的init calib complete都没拉高》','https://www.xiaopingtou.net/q-164302.html','页面编码gb2312|utf-8默认gb2312'));){kind=link}
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