FPGA回放正弦波及输出正弦波的畸变问题

2020-01-26 17:45发布

FPGA内接收数据后再回放正弦波,波形有很多毛刺,特别是波峰和波谷处,什么原因呢?
q1.jpg

在FPGA内生成一个ROM,存放正弦波数据,读取后输出,波形基本正确,但仍然有很多畸变,像是突发式的,何解啊,求指导!!
q2.jpg
感谢大虾们!
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7条回答
以马内利3005
1楼-- · 2020-01-26 18:19
以马内利3005
2楼-- · 2020-01-26 22:11
已解决!
chenzhi658
3楼-- · 2020-01-27 02:55
以马内利3005 发表于 2015-1-19 22:08
已解决!

什么问题?怎么解决的
以马内利3005
4楼-- · 2020-01-27 06:39
 精彩回答 2  元偷偷看……
以马内利3005
5楼-- · 2020-01-27 09:29
风魔小象 发表于 2015-1-23 20:34
楼主分享经验啊

不使用always @(posedge BCLK)语法,而是用系统时钟来锁定BCLK的上升沿,拉高某寄存器电平(一个系统时钟周期),每检测到一次上升沿传输一个数据,即可。
富富嘟嘟
6楼-- · 2020-01-27 10:12
以马内利3005 发表于 2015-1-26 23:46
不使用always @(posedge BCLK)语法,而是用系统时钟来锁定BCLK的上升沿,拉高某寄存器电平(一个系统时钟 ...

什么意思呀

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