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FPGA
急急急!!!Xilinx RapidIO IP核设计示例问题
2020-02-02 12:43
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FPGA
5909
17
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我用Ise14.4套件的Core Generator 生成了一个RapidIO Ip核,我把它自动生成的那个example_design放入一个新的工程中,然后仿真,波形正确,我仔细看了里面的代码,发现无论目的deviceId如何变化,波形显示都能够正常的收发,难道rapidIO不用通过DeviceId来确定发的目地吗?!!
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16条回答
GoldSunMonkey
1楼-- · 2020-02-04 00:06
奇怪啊
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hjz07091982
2楼-- · 2020-02-04 00:19
Rapdio要收费吧?
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GoldSunMonkey
3楼-- · 2020-02-04 05:02
精彩回答 2 元偷偷看……
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18307471859
4楼-- · 2020-02-04 10:48
vivadio上调用的这个rapidio gen2 我申请了license 为什么还是不能生成bit文件,一直报错
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