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FPGA
自己编写的模块,EOC是输入引脚,但读不出来
2020-02-03 11:27
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FPGA
15397
4
4
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EOC是wire型变量,但是检测不到EOC=0的情况,为什么啊,求助
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3条回答
yanguangkuo
1楼-- · 2020-02-03 15:18
精彩回答 2 元偷偷看……
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玄德
2楼-- · 2020-02-03 20:00
状态机。
说明EOC一直是高,所以检测不到。
另外,如何知道状态是4?比较怀疑。
学学仿真吧。
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yanguangkuo
3楼-- · 2020-02-03 21:32
玄德 发表于 2016-7-15 16:25
状态机。
说明EOC一直是高,所以检测不到。
另外,如何知道状态是4?比较怀疑。
EOC有低电平的时候,用示波器可以观测到。但是自己编写的模块检测不到。我用示波器观测引脚,就是卡在状态4了
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