本帖最后由 mdykj33 于 2016-1-5 09:28 编辑
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初步接触FPGA的同学,对FPGA的代码都不是很了解。本节课通过讲解一份verilog代码,介绍一个module文件的各个部分,如端口申明、信号定义和主体程序。
同学们通过本节课的学习,对FPGA程序有一个感性认识。特别是要读懂主体程序。
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