2020-02-08 09:07发布
xiaodao35 发表于 2012-7-22 16:09 只要ISP口上没有容性负载，做输入时外围电路不能强制拉高或拉低，因该不影响。 ...
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请问什么叫外围电路不能强制拉高或拉低？。我是新手，抱歉。。。
我就是做SCK和MOSI的，纯输出
但是老师要我在输出脚加小电容（2nF）小电阻（51R）做了个RC滤波器说滤掉干扰。。
会不会有影响？我想这样编程时钟肯定不能高~
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