2019-03-25 14:25发布
chunyang 发表于 2017-8-2 21:00 把采样电阻串到负载与MOS管之间。
清苦微甜 发表于 2017-8-3 13:33 谢谢! 我还有一个疑问,平常见到类似的图,采样电阻一般是放在源级和地之间的, 如果放到负载和漏级之 ...
chunyang 发表于 2017-8-3 15:34 采样电阻放在接地一侧是为了方便,后面用运放做信号放大时,单端电路就可以直接用,而且供电可以和MCU共 ...
清苦微甜 发表于 2017-8-4 10:06 恩呢,后级目前是直接连到MCU的,没有用运放,实际也不会用运放在这里,毕竟成本有限。 采样电阻一挪动 ...
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谢谢!
我还有一个疑问,平常见到类似的图,采样电阻一般是放在源级和地之间的,
如果放到负载和漏级之间的话,在采样过程中,mos管的导通压降是不是容易对采样造成影响呢?
采样电阻放在接地一侧是为了方便,后面用运放做信号放大时,单端电路就可以直接用,而且供电可以和MCU共享,整体电路最简单。如果放在负载侧甚至电源侧,麻烦在于后级放大电路,运放必须采用高压供电,而且输出如果送MCU或ADC的话,很可能还需要做电平平移,自然电路就复杂了。
恩呢,后级目前是直接连到MCU的,没有用运放,实际也不会用运放在这里,毕竟成本有限。
采样电阻一挪动,mos问题解决了,采样方法就要麻烦一点。
如果想沿用老电路的话,我感觉只能在输入处将电平转到12V来保证GS电压足够了,不知道可不可行。
是的,控制电压需要提升,可以用光耦和晶体管实现。
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