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FPGA
多周期约束问题求解
2020-02-23 10:46
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FPGA
7801
1
1
代码中有直接使用了触发运算,有一定的数据延时,所以使用了多周期约束。
我的问题是,如下图所示,else if语句中前两个在SDC文件中进行了多周期约束,由于这四个左值下一步需要同时存储在RAM中,
那么后两个是不是也应该进行相同周期的多周期约束,才能确保数据运算正确?(
现在后两个计算存在误差
)
如果需要约束的话,由于后两个没有时序报错,如何约束?
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