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xilinx 中管脚约束怎选择?
2020-02-24 20:23
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FPGA
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ise 中IO Pin Planning-pre-synthesis可以选择Gclk脚到clk信号，但是IO pin Planning-post-Synthesis却不能够选，信号选管脚下拉菜单时见不到GCLK管脚，这是怎么回事呢？
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