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FPGA
求助：结构体中使用signal和variable最后综合有什么区别呢
2020-02-24 20:40
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FPGA
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2条回答
yghanwuji
1楼-- · 2020-02-24 23:13
一个是信号下一个时钟赋值，一个是变量立即赋值
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EDAbuffalo
2楼-- · 2020-02-25 00:28
精彩回答 2 元偷偷看……
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