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FPGA
如何禁止综合器讲某个信号走BUFG
2020-02-27 21:05
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FPGA
2865
6
6
大家好,使用xilinx的xst,综合后我并不想某根信号走BUFG全局,哪个原语可以实现?谢谢了
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5条回答
haitaox
1楼-- · 2020-02-27 22:17
(* BUFFER_TYPE="NONE" *) wire clk_buffer_none;
加载中...
haitaox
2楼-- · 2020-02-27 23:45
ise自带的template非常有帮助
加载中...
41402169
3楼-- · 2020-02-28 00:12
谢谢 我当时找了一会没有找到~
加载中...
fenglema
4楼-- · 2020-02-28 02:26
学习了!高手果然多
加载中...
GoldSunMonkey
5楼-- · 2020-02-28 04:04
精彩回答 2 元偷偷看……
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