FPGA测试光电编码器转速--高低电平不均匀问题

2020-02-27 21:09发布

用FPGA测试光电编码器转速时,编码器的测试效果用signaltap显示出来了,现在有个问题是,A,B的高低电平持续时间不均匀,可能是什么原因啊? 求指教……
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9条回答
GoldSunMonkey
1楼-- · 2020-02-28 19:17
lbqq2006013 发表于 2013-10-8 14:50
示波器测得是均匀的……

那就没什么问题。
这个因为你采样时钟的问题造成的
GoldSunMonkey
2楼-- · 2020-02-28 21:03
huangxz 发表于 2013-10-8 17:11
你用示波器的脉宽触发模式看看有没有特别的脉冲出现,因为你看示波器也是用肉眼看啊 ...

:handshake
lbqq2006013
3楼-- · 2020-02-29 02:52
GoldSunMonkey 发表于 2013-10-8 23:03
那就没什么问题。
这个因为你采样时钟的问题造成的

恩,和他们商量了下,是采样时钟频率不够的原因,那个小格其实是不可避免的吧?除非是2的整数次方,多谢拉……

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