请问如何通过改变不同的计数初值，来使计数器产生进位输出，产生不同的周期信号

2019-07-15 20:35发布

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具体设计看图，大概就是通过改变不同的计数初值，来使计数器产生进位输出，产生不同的周期信号。使用VHDL语言。

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2条回答

1楼-- · 2019-07-15 23:24

建议可以看下一些频率相关的VHDL例程比如频率计一类的最佳答案

2楼-- · 2019-07-16 02:44

建议看一下半加器和全加器的原理，这样对于你的设计会更好的理解