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Xilinx 在ISE已完成的工程文件中添加IP核
2019-07-15 21:08
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FPGA
3747
6
1474
已经有一个现成的AD采样模块，现在想添加功能，所以想在源工程中添加一个后续处理IP核，添加之后不知如何处理。
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6条回答
hwaming
1楼-- · 2019-07-15 21:54
精彩回答 2 元偷偷看……
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fudadaqaz987
2楼-- · 2019-07-16 02:05
好
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fudadaqaz987
3楼-- · 2019-07-16 05:31
谢谢
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xwd_bp
4楼-- · 2019-07-16 08:20
关注，学习。
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xwd_bp
5楼-- · 2019-07-16 10:55
关注，学习。
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zym050328
6楼-- · 2019-07-16 10:57
精彩回答 2 元偷偷看……
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