vivado中synthesis通过，implement通过，但是在编译simula
tion的时候报错：
[USF-XSim-62] 'compile' step failed with error(s). Please check the Tcl console output or 'C:/Users/Administrator/Desktop/shuma/shumaxianshi/shumaxianshi.sim/sim_1/behav/xvlog.log' file for more information.
[Vivado 12-4473] Detected error while running simulation. Please correct the issue and retry this operation.
语言为verilog
这个问题怎么解决哇
哭死了要
{var%20f='http://v.t.sina.com.cn/share/share.php?appkey=1515056452',u=z||d.location,p=['&url=',e(u),'&title=',e(t||d.title),'&source=',e(r),'&sourceUrl=',e(l),'&content=',c||'gb2312','&pic=',e(p||'')].join('');function%20a(){if(!window.open([f,p].join(''),'mb',['toolbar=0,status=0,resizable=1,width=440,height=430,left=',(s.width-440)/2,',top=',(s.height-430)/2].join('')))u.href=[f,p].join('');};if(/Firefox/.test(navigator.userAgent))setTimeout(a,0);else%20a();})(screen,document,encodeURIComponent,'','','https://www.xiaopingtou.cn/data/attach/logo/logo.png', '推荐 zhangbohan0821 的问题《关于vivado的sim问题求解！》','https://www.xiaopingtou.net/q-44894.html','页面编码gb2312|utf-8默认gb2312'));){kind=link}
好的
编译错误了，你确定你这代码综合，实现可以通过？撇开其他模块，这个top模块你得多检查检查，感觉有点是tb文件（PS:以后贴代码别把无用的代码都贴出来
一周热门 更多>