vhdl的语法问题

2019-07-15 22:21发布

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al := a and b or a and c or b and c;
有谁知道这语句错哪了吗?

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2条回答

1楼-- · 2019-07-16 03:06

就给看这么一句话，哪都是错啊。你应该把整个代码贴出来。如果是输入或输出的初始化定义，不是这么写，如果是信号的赋值语句，更不是这么写。

2楼-- · 2019-07-16 04:46

:=用于对常量（CONSTANT）和变量（VARIABLE）的赋值，<=用于对信号（SIGNAL）的赋值。