本帖最后由 elecfans跑堂 于 2015-9-14 09:21 编辑
最近在做FPGA板子用了两片16位的FPGA，在MIG中发现ODT 和CK CS等信号需要分别连接到FPGA。如下图，是我在MIG中设置的问题吗？还是xilinx DDR2 MIG就要求这么做？
最近在做FPGA板子用了两片16位的FPGA，在MIG中发现ODT 和CK CS等信号需要分别连接到FPGA。如下图，是我在MIG中设置的问题吗？还是xilinx DDR2 MIG就要求这么做？
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我看了一些官方的设计也是需要分别连接的
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