FPGA

带有UPF的DC，遇到的问题，求教

2019-07-16 00:11发布

站内问答 / FPGA
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tica, Arial, sans-serif">在逻辑综合时 ，有些线还没有布上，出现这样 的信息是正确的吗？
Skip level shifter insertion because suitable supply nets are not found。



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1条回答
宫恩来
1楼-- · 2019-07-16 05:24
跳过电平移位器插入，因为没有找到合适的供应网

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