2019-07-16 00:15发布
小梅哥 发表于 2014-12-28 10:52 学习verilog的好，资料多，和c语言比较相似，学起来快些。vhdl相对死板。仿真软件就用modelsim。如果需要更 ...
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设计要求用VHDL 可以慢慢学 想问下VHDL编程软件现在都用什么？谢谢了~
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