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这几天在看《FPGA/ASIC高性能数字系统设计》，看到54页关于条件选择符与always选择的比较，试着做了下实验。
本来书上的结果应该是这样的：
但我写的两段代码和综合后的RTL级视图居然一样，而不是像书本上的有优劣之分，并且还都是第一种占资源的结果。
我用的是QuartusII 12.0
两种结果：
我感觉可能是综合工具的问题，但QuartusII更新到12.0应该不会忽略这样的优化吧。
对于这种结果不知道各位大神是怎么看的？
也不知道各位谁能综合出书本上的结果。
本来书上的结果应该是这样的：
但我写的两段代码和综合后的RTL级视图居然一样，而不是像书本上的有优劣之分，并且还都是第一种占资源的结果。
我用的是QuartusII 12.0
两种结果：
我感觉可能是综合工具的问题，但QuartusII更新到12.0应该不会忽略这样的优化吧。
对于这种结果不知道各位大神是怎么看的？
也不知道各位谁能综合出书本上的结果。
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