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FPGA
关于sdram的读取问题
2019-07-16 01:42
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/
FPGA
7809
6
1598
本帖最后由 unpopfeng 于 2013-4-26 15:51 编辑
特权同学你好,我正在看你所写的《深入浅出玩转
FPGA
》,在做里面的DIY数码相框,我想问问,如果SDRAM的读出数据出现读空现象,会是什么原因呢?
另外我很奇怪,,实际程序时钟50M,sdram时钟100M,signaltap采样时钟50m;SD卡读出数据频率是50M,但是VGA显示里,行有效时间是800ns? SDRAM读数据周期是1ns?这又是为什么呢?
如果你有空,
就麻烦你了
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6条回答
unpopfeng
1楼-- · 2019-07-16 02:58
精彩回答 2 元偷偷看……
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特权同学
2楼-- · 2019-07-16 04:57
signaltap采样时钟原理和示波器差不多,根据奶奎斯特定律,你自己算算你的采样时钟需要多大才能够正确采集到50MHz的信号?
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frwfpga
3楼-- · 2019-07-16 08:32
这是什么 不会搞点 复杂的
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Lisely
4楼-- · 2019-07-16 12:56
特权同学 我想对这里的采样时钟提下问:
1.chipscope或者signatap采样分析信号应该是将其存在内部的ram,那么对于同步的时钟下的同步信号,高低电平的,应该是对着其信号频率来,可以在信号输出时给出一个系统周期的输出有效信号,那么只要设置触发,就能得到需要观察的信号;
2.对于观察波形,为什么这里会有奈斯定理呢?我分析认为,这其实是和示波器原理一样,虽然我们知道采集存取下来的信号仍然是离散,再将其绘成波形,但是由于人眼来观察,而人眼结构有低通滤波的效果,因此满足奈斯定律能保证人眼能够正确看到波形信号 ,便于直观分析观察。
个人觉得,奈奎斯特定理并不是说要采集信号都要满足,而是对于观察一些波形信号最好满足,不然低于那个频率,就会出现假频,倒频等等。而一些总线宽度的信号,要每次有效信号周期采样,做到不遗漏一个周期内的信号就可以了,即频率最好相等,越接近越好,看时机分析的需要而定。
以上个人分析,如有偏颇和不同,还请一定赐教交流。多谢。
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Lisely
5楼-- · 2019-07-16 18:47
不好意思 我需要对上面的观察波形部分作一些修正,众所周知,如果一个信号 频率过快,用肉眼是观察不到真实的波形的,就像用示波器去观察一个100MHz的信号,由于扫频频率以及余辉,设置正确的采样点数也是用肉眼直观看出来的,可以看到“重影”,这里我喜欢看频谱(math:FFT)。因此,我认为对于波形也应该是在肉眼(眼睛截止频率处)可以达到的频率用signaltap采样满足奈斯定理才能直观看到正确波形,对于那些很高的波形信号,其实满足奈斯定理也是没问题的,只是你也不能直观看的清楚,我认为太高(超出肉眼分辨)的频率下满足能不漏掉每个周期的有效信号就可以了,能够我们分析就好。
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893018902
6楼-- · 2019-07-16 19:32
精彩回答 2 元偷偷看……
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1.chipscope或者signatap采样分析信号应该是将其存在内部的ram,那么对于同步的时钟下的同步信号,高低电平的,应该是对着其信号频率来,可以在信号输出时给出一个系统周期的输出有效信号,那么只要设置触发,就能得到需要观察的信号;
2.对于观察波形,为什么这里会有奈斯定理呢?我分析认为,这其实是和示波器原理一样,虽然我们知道采集存取下来的信号仍然是离散,再将其绘成波形,但是由于人眼来观察,而人眼结构有低通滤波的效果,因此满足奈斯定律能保证人眼能够正确看到波形信号 ,便于直观分析观察。
个人觉得,奈奎斯特定理并不是说要采集信号都要满足,而是对于观察一些波形信号最好满足,不然低于那个频率,就会出现假频,倒频等等。而一些总线宽度的信号,要每次有效信号周期采样,做到不遗漏一个周期内的信号就可以了,即频率最好相等,越接近越好,看时机分析的需要而定。
以上个人分析,如有偏颇和不同,还请一定赐教交流。多谢。
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