电路设计

规格书中Reset Timing的疑问

2019-07-16 08:24发布

站内问答 / 电路设计
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如图，图中reset信号中这个平行四边形是什么意思？
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8条回答
天暗下来
1楼-- · 2019-07-16 08:42
以及为何一个信号, 可以'量子叠加'态, 同时即是高, 又是低。是我理解有问题还是规格书的问题
皮皮鲁鲁鲁皮
2楼-- · 2019-07-16 10:11
 精彩回答 2  元偷偷看……
hdfsf
3楼-- · 2019-07-16 15:54
相对CS下降沿的建立时间保持时间。
天暗下来
4楼-- · 2019-07-16 21:11
@皮皮鲁鲁鲁皮 谢谢指教，但我还是没太懂，你的意思是, 此dataSheet 用平行四边形 表示这个信号的Jitter 吗?如果是这样, 与题意不符, 它想表达Set up time/ hold time, (两个时间点)
皮皮鲁鲁鲁皮
5楼-- · 2019-07-17 01:13
就波形图上的解释，RESET# 可能会在 CS# 拉高的前后被拉低。
可能出现 CS# 在拉高前，也可能出现在 CS# 拉高后。
由于 tRS 和 tRH 都是 15Min，所以 RESET# 拉低和 CS# 拉高都会保持 15以上的时间差。
因为只有 Datasheet 剪下的一段，不知道有没有前后文辅助说明，只能做这样的解读
kingnet_520888
6楼-- · 2019-07-17 05:48
建议楼主可以看下wiki上对set time和hold time的表述
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