如何解决Altium Designer中Adding items to hidden net GND

2019-07-16 21:24发布

tica, SimSun, sans-serif">最近在做数电的课程设计,在原理图编译的时候出现两个错误:adding items to hidden net GND 和 adding items to hidden net VCC, 上网找了各种解决方法,说把 show all pin on sheet(even if hidden)的选项勾上和去掉 lock pin 这个选项,然后再连接GND VCC就OK, 可惜还是不行!请问该怎样解决!谢谢
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12条回答
jiang8121
1楼-- · 2019-07-16 21:27
怎么都没有人解决呢~~~?
shixin0202
2楼-- · 2019-07-16 21:36
同求。。。。。。
nhliming
3楼-- · 2019-07-17 02:09
 精彩回答 2  元偷偷看……
xfwxqx
4楼-- · 2019-07-17 06:59
有的器件原理图隐藏了VCC与GND或有的器件有多个部分,只用到了一部分,VCC与GND默认不显示出来。解决方法,双击元件,勾选左下角显示所有引脚(即使隐藏)。
destrukt
5楼-- · 2019-07-17 10:30
双击元件,勾选左下角显示所有引脚(即使隐藏)。
_Huang
6楼-- · 2019-07-17 12:11
xfwxqx 发表于 2015-4-14 13:46
有的器件原理图隐藏了VCC与GND或有的器件有多个部分,只用到了一部分,VCC与GND默认不显示出来。解决方法,双击元件,勾选左下角显示所有引脚(即使隐藏)。

错误依旧存在

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