2019-07-18 09:59发布
JQ_Lin 发表于 2017-2-14 21:26 改引脚后，程序和仿真电路图不一致了。这个错误不容易被发现。 原口未按顺序排列（７，５，６），新口按顺序排列（２，１，０），电路图却为逆序排列（０，１，２）。
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我知道问题在哪了，我改动的引脚在keil里不知道为什么没有保存进去，现在已经可以了，谢谢了
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