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• kdy 2019-03-26 02:11

FPGA做AD采样，这种情况如何编程？

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• kdy 2019-03-26 01:49

FPGA和PCI9056接口问题求助！

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• kdy 2019-03-26 00:57

最近在做fpga最小系统，遇到问题求教

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• kdy 2019-03-26 00:54

SDRAM刷新

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• kdy 2019-03-26 00:37

vhdl的for循环综合问题

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• kdy 2019-03-26 00:03

想用verilog HDL编一个计算器，小数点的算法解决不了

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• kdy 2019-03-25 23:35

各位大神求助

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• kdy 2019-03-25 23:26

高速数据并串转换，上升沿下降沿采样问题

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• kdy 2019-03-25 22:46

quartus 编译出错

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• kdy 2019-03-25 22:45

求助下 为什么HEX数码管还有OUTS仿真不出来 新手求助啊啊啊

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• kdy 2019-03-25 22:39

收发器在接收端为什么要采用一个bitslip模块以及该模块的实现

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• kdy 2019-03-25 22:37

求助！！波形延时复制出现问题。

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• kdy 2019-03-25 22:33

PC机通过PCIE向FPGA传输数据的问题

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• kdy 2019-03-25 22:32

不采用dds技术，做一个正弦波发生器

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• kdy 2019-03-25 22:12

有关分频的程序