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• HDLWorld 2019-03-26 09:19

Q&A工程师在线：FPGA领域相关问题，可在此提问

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• HDLWorld 2019-03-26 06:26

时序仿真正确，RTL视图中输入引脚没连上任何信号

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• HDLWorld 2019-03-26 06:03

新手求救~FPGA EP4CE6E22C8N + EPCS4S18 无法正常动作

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• HDLWorld 2019-03-26 05:40

关于modelsim后仿真

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• HDLWorld 2019-03-26 02:49

fpga中的串口ip核中的波特率能调吗

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• HDLWorld 2019-03-25 23:22

问几个菜鸟问题

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• HDLWorld 2019-03-25 22:56

求大神看看这段程序啊

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• HDLWorld 2019-03-25 22:05

求助：为什么 CHIPSCOPE 对一些信号抓不到？？

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• HDLWorld 2019-03-25 21:47

网上看的串口自发自收的代码有点疑问，感觉是小问题，帮看下

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• HDLWorld 2019-03-25 20:57

fpga功耗问题

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• HDLWorld 2019-03-25 20:45

blackbox 生成方法求教

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• HDLWorld 2019-03-25 20:43

如何修正时序约束中slack为负的问题

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• HDLWorld 2019-03-25 19:43

新手求救~FPGA EP4CE6E22C8N + EPCS4S18 无法正常动作

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• HDLWorld 2019-03-25 19:01

vim中verilog/VHDL怎么自动缩进啊？？

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• HDLWorld 2019-03-25 18:29

如何获得FPGA的ip地址