寒剑孤影的回答 - 平头弟

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寒剑孤影 2019-03-26 03:12

Verilog多个模块怎么整合到一块，然后通过下载线下载到FPGA里边呢，谢谢

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寒剑孤影 2019-03-25 23:03

altera的FIR ip核为什么不能仿真呢?[更新1]

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寒剑孤影 2019-03-25 13:55

求助一个DDS工程，最好是用EP2C8Q208C8做的