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• reallmy 2019-07-15 22:35

FPGA里always以posedge clk为敏感源，当always内部程序过多时，会超过一个时钟

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• reallmy 2019-07-15 22:34

altera fpga同一bank下的io输出电压不一样，请教一下原因，谢谢

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• reallmy 2019-07-15 22:33

刚入门FPGA的小萌新有个关于数据采集的问题？

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• reallmy 2019-07-15 22:31

两种仿真软件仿真结果不一样怎么回事

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• reallmy 2019-07-15 22:10

modelsim is exiting with code 7???

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• reallmy 2019-07-15 22:06

synplify综合问题，跪求解决方法

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• reallmy 2019-07-15 21:59

FPGA 验证方法讨论

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• reallmy 2019-07-15 21:58

我要做一个3位计数器，为什么Q2哪里没有波形呢？

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• reallmy 2019-07-15 21:43

ModelSim仿真出现near timescal！！！

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• reallmy 2019-07-15 21:10

请问一下Quartus波形仿真中怎么输入正弦波？

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• reallmy 2019-03-27 07:07

FPGA信号同步问题

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• reallmy 2019-03-27 03:55

图像处理资料

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• reallmy 2019-03-26 23:18

图像处理资料

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• reallmy 2019-03-26 17:36

win7 32位旗舰版安装Quartus II13.0时安到最后老是出错，请问有谁知道什么原因吗

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• reallmy 2019-03-26 16:22

几乎零基础，学FPGA，到能简单编程，要多久