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• LQVSHQ 2019-07-16 06:30

有偿求助：RTL8365MB/RTL8363SB 寄存器问题

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• LQVSHQ 2019-07-16 06:09

时序仿真出现高阻态

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• LQVSHQ 2019-07-16 05:52

modelsim仿真波形显示cnt没有计数 没有输出 怎么回事

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• LQVSHQ 2019-07-16 05:46

差分输入问题

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• LQVSHQ 2019-07-16 05:04

请大神帮我看一下FPGA的电动机代码写的对不对？急用

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• LQVSHQ 2019-07-16 04:57

请各位大神看看代码，产生两路脉冲的verilog程序

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• LQVSHQ 2019-07-16 04:46

对50MHZ时钟分频，输出1KHZ时钟信号和100HZ时钟信号

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• LQVSHQ 2019-07-16 03:57

基础语法语法问题

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• LQVSHQ 2019-07-16 03:46

模块例化错误

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• LQVSHQ 2019-07-16 02:52

请问一个时序逻辑always块中，写多个if...else if ...else if...语句和用

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• LQVSHQ 2019-07-16 02:43

新手请教一个赋值语句问题

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• LQVSHQ 2019-07-16 02:36

时序仿真出现高阻态

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• LQVSHQ 2019-07-16 02:23

单个模块仿真正常，顶层例化后仿真无波形。

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• LQVSHQ 2019-07-16 01:56

上升沿检测问题

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• LQVSHQ 2019-07-16 01:52

Xilinx FPGA DCI使用方法