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• 碧水2012 2019-03-26 09:58

计数时序求助

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• 碧水2012 2019-03-26 05:35

计数时序求助

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• 碧水2012 2019-03-26 01:53

FPGA项目外包

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• 碧水2012 2019-03-26 00:50

ISE中的一个警告<sys_ret> is already implicitly dec

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• 碧水2012 2019-03-26 00:02

第一次搞FIFO，数据貌似写不进去，求助Ing

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• 碧水2012 2019-03-25 23:37

ISE中调用DDR2IP核仿真的问题

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• 碧水2012 2019-03-25 20:53

ISE中调用DDR2IP核仿真的问题

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• 碧水2012 2019-03-25 20:36

FPGA项目外包

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• 碧水2012 2019-03-25 18:32

ISE中的一个警告<sys_ret> is already implicitly dec

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• 碧水2012 2019-03-25 16:03

求高手指点testbench我的第一个testbench可对啊？

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• 碧水2012 2019-03-25 15:37

FPGA项目外包

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• 碧水2012 2019-03-25 15:21

计数时序求助

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• 碧水2012 2019-03-25 12:15

FPGA项目外包

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• 碧水2012 2019-03-25 11:49

fpga 综合报错,请大侠们指点