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• huangxz 2020-02-28 06:48

FPGA速度等级问题

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• huangxz 2020-02-28 06:03

FPGA用verilog点亮一个led，用了两种方法有疑问求教！

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• huangxz 2020-02-28 05:01

想学FPGA 哪款比较合适

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• huangxz 2020-02-28 04:27

Vreilog 的sourceinsight 插件

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• huangxz 2020-02-28 02:50

FPGA与DSP通信接口的问题，新手求帮助

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• huangxz 2020-02-28 02:33

FPGA测试光电编码器转速--高低电平不均匀问题

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• huangxz 2020-02-28 02:08

用Virtex5控制NANDFlash芯片出现的问题：R/B信号一直无变化

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• huangxz 2020-02-28 01:20

VERILOG怎么样实现顶层文件调用其他模块？

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• huangxz 2020-02-27 22:45

FPGA芯片解密重金求助

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• huangxz 2020-02-27 22:21

求大神指点！quartus II这些变量被编译器当作clk怎么解除？？

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• huangxz 2020-02-25 19:51

cpld写lcd的时序，第一次写vhdl，大家帮忙看看有问题没

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• huangxz 2020-02-25 16:25

synplify pro最新版官网下载

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• huangxz 2020-02-25 11:12

synplify pro最新版官网下载

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• huangxz 2020-02-25 06:09

有人愿意赚钱写个USB上位机程序么？

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• huangxz 2020-02-25 05:23

关于verilog实现CRC的问题