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• GoldSunMonkey 2020-02-28 19:45

威视锐ZYNQ开发板-ZingSK高清视频接口实例--HDMI

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• GoldSunMonkey 2020-02-28 19:43

基于赛灵思FPGA的航空总线协议接口设计

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• GoldSunMonkey 2020-02-28 19:41

威视锐ZYNQ开发板-ZingSK-USB摄像头视频采集与QT显示存储

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• GoldSunMonkey 2020-02-28 19:35

FPGA verilog的编程心得

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• GoldSunMonkey 2020-02-28 19:34

FPGA如何改变改变嵌入设计格局？

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• GoldSunMonkey 2020-02-28 19:33

回到未来：用图形化方法快速实现复杂的SoC设计

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• GoldSunMonkey 2020-02-28 19:32

参加快乐分享活动-基于spartan6的DDR2的研究

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• GoldSunMonkey 2020-02-28 19:31

计数器为什么会错位

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• GoldSunMonkey 2020-02-28 19:29

Xilinx All Programmable 28nm器件全线通过PCIe规范测试

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• GoldSunMonkey 2020-02-28 19:24

怎么用xilinx那个cordic核做对数运算哦？

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• GoldSunMonkey 2020-02-28 19:23

计数器为什么会错位

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• GoldSunMonkey 2020-02-28 19:21

要是电路的原理图能用verilog画就好了

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• GoldSunMonkey 2020-02-28 19:19

xilinx rapidIO IP example_design工程translate总是出错

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• GoldSunMonkey 2020-02-28 19:18

如何在FPGA 中实现状态机

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• GoldSunMonkey 2020-02-28 19:18

赛灵思Spartan®-6 FPGA 工业以太网套件介绍