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数字PID控制算法

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FPGA之按键消抖检测

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VERILOG怎么样实现顶层文件调用其他模块？

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找个design house&个人设计1-wire 从机

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如何禁止综合器讲某个信号走BUFG

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XILINX在Transceiver用户手册里提出了对模拟电源的文波噪声要求

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Xilinx在IDF13上展示业界首款FPGA 80Gbps网络接口卡和最新Intel QPI

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XILINX 功耗据算软件 XPE

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我想计算一个多项式（xilinx verilog）

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如何取通信时钟的最佳周期，来进行通信？

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• GoldSunMonkey 2020-02-28 03:20

基于赛灵思FPGA软核的高速数据采集系统设计

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• GoldSunMonkey 2020-02-28 03:15

FPGA烧毁问题