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• GoldSunMonkey 2020-02-27 23:02

如何通过DDR3控制器将DDR3应用到具体的工程里面

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• GoldSunMonkey 2020-02-27 22:59

XILINX在Transceiver用户手册里提出了对模拟电源的文波噪声要求

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• GoldSunMonkey 2020-02-27 22:57

Simulink GBK ERR 中文字符 不能保存问题

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• GoldSunMonkey 2020-02-27 22:52

xilinx rapidIO IP example_design工程translate总是出错

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• GoldSunMonkey 2020-02-27 22:46

mig生成ddr2的ip核时序问题

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• GoldSunMonkey 2020-02-27 22:37

基于Virtex5的Gbps无线通信基站设计

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• GoldSunMonkey 2020-02-27 22:13

基于赛灵思FPGA的高速图像采集系统中的应用设计

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• GoldSunMonkey 2020-02-27 22:12

利用串行RapidIO连接功能增强DSP协处理能力

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• GoldSunMonkey 2020-02-27 22:06

ZedBoard Schematics

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• GoldSunMonkey 2020-02-27 22:02

基于赛灵思FPGA软核的高速数据采集系统设计

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• GoldSunMonkey 2020-02-27 21:50

一种多芯片串行收发器纠偏方法

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• GoldSunMonkey 2020-02-27 21:37

XILINX的AXI DATAMOVER IP CORE的问题

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• GoldSunMonkey 2020-02-27 21:26

求XC9500XL系列开发板原理图

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• GoldSunMonkey 2020-02-27 21:21

赛普拉斯发布集成了USB的超低功耗PSoC 1器件

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• GoldSunMonkey 2020-02-27 21:11

基于赛灵思FPGA的高速通信系统研究