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• GoldSunMonkey 2020-03-01 04:05

源时钟和目的时钟为什么相差一个clock？

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• GoldSunMonkey 2020-03-01 04:05

如何学习FPGA

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• GoldSunMonkey 2020-03-01 04:04

ISE璀﹀憡

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• GoldSunMonkey 2020-03-01 04:03

ISE 一些tips

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• GoldSunMonkey 2020-03-01 04:02

分享：任意奇数分频（50%占空比） verilog 代码

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• GoldSunMonkey 2020-03-01 03:54

ISE璀﹀憡

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• GoldSunMonkey 2020-03-01 03:41

如何让FPGA画圆

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• GoldSunMonkey 2020-03-01 03:16

特权同学SD卡代码疑问begin end 中连续出现两个 if 如何分析？

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• GoldSunMonkey 2020-03-01 03:00

CPLD/FPGA可以用133M的晶振么

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• GoldSunMonkey 2020-03-01 02:53

关于PROCESS语句中敏感量问题，求证。

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• GoldSunMonkey 2020-03-01 02:46

Quartusii中使用了SignalTap后，仿真无法进行

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• GoldSunMonkey 2020-03-01 02:37

FPGA做JPAG解码

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• GoldSunMonkey 2020-03-01 02:22

VHDL映射关系

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• GoldSunMonkey 2020-03-01 02:19

灏忓晱椤? 鏈変汉骞繖瑙ｆ晳涓€涓嬪棊?

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• GoldSunMonkey 2020-03-01 02:15

verilog parmater的问题